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IEEE 1164 [Modificación ]
El estándar IEEE 1164 define una unidad de diseño de paquete que contiene declaraciones que admiten una representación uniforme de un valor lógico en una descripción de hardware VHDL. Fue patrocinado por el Comité de Estándares de Automatización de Diseño del Instituto de Ingenieros Eléctricos y Electrónicos (IEEE). El esfuerzo de estandarización se basó en la donación de la declaración tipo Synopsys MVL-9.
El tipo de datos primario std_ulogic (lógica estándar no resuelta) consta de nueve literales de caracteres en el siguiente orden:

Este sistema promovió un conjunto útil de valores lógicos que los diseños típicos de lógica CMOS podrían implementar en la gran mayoría de las situaciones de modelado. El literal 'Z' hace que la lógica del buffer tri-estado sea fácil. Los accionamientos débiles 'H' y 'L' permiten la lógica Wired-AND y Wired-OR. Además, el estado 'U' es el valor predeterminado para todas las declaraciones de objetos, de modo que durante las simulaciones los valores no inicializados son fácilmente detectables y, por lo tanto, se pueden corregir fácilmente si es necesario.
En VHDL, el diseñador de hardware hace que las declaraciones sean visibles a través de la siguiente biblioteca y use sentencias:


biblioteca IEEE;
use IEEE, std_logic_1164, todo;
1.Usar valores en simulación
1.1.Uso de 'U'
1.2.Uso de 'X'
1.3.Uso de 'Z'
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